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ID
2510374
Banca
NC-UFPR
Órgão
ITAIPU BINACIONAL
Ano
2017
Provas
Disciplina
Arquitetura de Computadores
Assuntos

Considere um esquema de mapeamento de endereços para memória cache conjunto associativa de duas vias, com endereço de memória principal de 32 bits fornecido pelo processador, sendo a memória organizada em blocos de oito palavras, cada palavra com quatro bytes. A memória cache possui 8Ki palavras. Qual endereço de bloco na memória cache é acessado (linha da cache) se o endereço fornecido pelo processador for 80004078 Hexadecimal?

Alternativas
Comentários
  • Alguém tem ideia de como resolve essa? Aquele Ki seria apenas "K" ou "Kb"?

  • Gabarito E. Mas alguém poderia explicar? Não entendi.

  • Vamos lá:

    Tamanho do bloco= 8 words ou 32 bytes

    Tamanho total de dados da cache = 8KiWords

    Associatividade de 2 vias.

    Logo temos número de linhas=(8x1024)/(2x8) = 512 linhas  ou 0x200 em hexadecimal

    Assim, o endereço em byte 0x4078 será mapeado para a linha dada por 0x4078/(0x20.0x200)  = 0x4078/0x4000 = 0x01 com resto 0x78  (é mais fácil fazer isso em hexa)

    Como temos 0x20 (32) bytes por linha (8 words) temos 0x78/0x20 = 0x03 com resto 0x18

    Resposta: linha 0x03

     

     

  • https://br.groups.yahoo.com/neo/groups/timasters/conversations/topics/258561